CY7C1481V33-100AXC Просмотр технического описания (PDF) - Cypress Semiconductor

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CY7C1481V33-100AXC

72-Mbit (2M x 36/4M x 18/1M x 72) Flow-Through SRAM

Cypress Semiconductor 

CY7C1481V33

CY7C1483V33

CY7C1487V33

Logic Block Diagram – CY7C1481V33 (2M x 36)

A 0, A1, A

MODE

ADV

CLK

ADSC

ADSP

BW D

BW C

BW B

BW A

BWE

GW

CE1

CE2

CE3

OE

ADDRESS

REGISTER

A [1:0]

BURST Q1

COUNTER

AND LOGIC

CLR

Q0

DQ D, DQP D

BYTE

WRITE REGISTER

DQ C, DQP C

BYTE

WRITE REGISTER

DQ B, DQP B

BYTE

WRITE REGISTER

DQ A, DQPA

BYTE

WRITE REGISTER

ENABLE

REGISTER

ZZ

SLEEP

CONTROL

Logic Block Diagram – CY7C1483V33 (4M x 18)

DQ D, DQP D

BYTE

WRITE REGISTER

DQ C, DQP C

BYTE

WRITE REGISTER

DQ B, DQP B

BYTE

WRITE REGISTER

DQ A, DQP A

BYTE

WRITE REGISTER

A 0,A1,A

MODE

ADV

CLK

ADSC

ADSP

BW B

BW A

BWE

GW

CE 1

CE 2

CE 3

OE

ZZ

ADDRESS

REGISTER

A[1:0]

BURST Q1

COUNTER AND

LOGIC

CLR

Q0

DQ B,DQP B

WRITE REGISTER

DQ A,DQP A

WRITE REGISTER

ENABLE

REGISTER

SLEEP

CONTROL

DQ B,DQP B

WRITE DRIVER

DQ A,DQP A

WRITE DRIVER

Document #: 38-05284 Rev. *H

MEMORY

ARRAY

MEMORY

ARRAY

SENSE

AMPS

OUTPUT

BUFFERS

DQ s

DQP A

DQP B

DQP C

DQP D

INPUT

REGISTERS

SENSE

AMPS

OUTPUT

BUFFERS

DQs

DQP A

DQP B

INPUT

REGISTERS

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